Texas Instruments LMK05318 Netzwerk-Synchronisierungs-Taktgeber mit BAW
Der Texas Instruments LMK05318 Netzwerk-Synchronisierungs-Taktgeber mit BAW bietet eine Jitter-Reinigung, Takterzeugung, erweiterte Taktüberwachung und hervorragende berührungslose Schaltleistung. Diese Funktionen sind zur Erfüllung der strengen Timing-Anforderungen von Kommunikationsinfrastrukturen und Industrieapplikationen vorgesehen. Der extrem geringe Jitter und die hohe Rauschunterdrückung bei der Versorgungsspannung (PSNR) des Bauteils können die Bitfehlerraten (BER) in seriellen Hochgeschwindigkeitsverbindungen reduzieren. Das Bauteil kann mit der proprietären Bulk Acoustic Wave (BAW) VCO-Technologie von TI unabhängig vom Jitter und der Frequenz der XO- und Referenzeingänge, Ausgangstakte mit einem RMS-Jitter von 50 fs erzeugen.
Die DPLL unterstützt eine programmierbare Schleifen-Bandbreite für Jitter, Wander-Dämpfung, während die beiden APLLs eine fraktionale Frequenzumsetzung für eine flexible Takterzeugung unterstützen. Die Synchronisierungsoptionen, die auf der DPLL unterstützt werden, umfassen berührungsloses Schalten, digitaler Holdover- und DCO-Modus mit einer Frequenzschrittgröße von weniger als 0,001 ppb für eine präzise Taktlenkung (IEEE 1588 PTP-Slave). Die DPLL kann an einen Referenzeingang von 1 PPS (Impuls pro Sekunde) phasengesperrt werden und unterstützt einen optionalen Nullverzögerungsmodus auf einem Ausgang, um eine deterministische Eingang-zu-Ausgangs-Phasenabstimmung mit einem programmierbaren Offset zu erzielen. Die erweiterte Referenzeingangsüberwachung gewährleistet eine robuste Taktfehlererkennung und trägt zur Reduzierung von Ausgangstaktstörungen bei, wenn ein Referenzverlust (LOR) auftritt.
Merkmale
- Eine digitale Phasenregelschleife (DPLL) mit
- berührungslosem Schalten: ±50 ps Phasenübergang
- Programmierbare Schleifen-Bandbreite mit Fastlock
- Standard-konforme Synchronisierungs- und Holdover-Modi über einen kostengünstigen TCXO/OCXO
- Zwei analoge Phasen-Regelschleifen (APLLs) mit einer branchenführenden Jitter-Leistung
- 50 fs RMS-Jitter bei 312,5 MHz (APLL1)
- 125 fs RMS-Jitter bei 155,52 MHz (APLL2)
- Zwei Referenztakteingänge
- Priorität-basierte Eingangsauswahl
- Digitaler Holdover-Modus bei Referenzverlust
- Acht Taktausgänge mit programmierbaren Treibern
- Bis zu sechs verschiedene Ausgangsfrequenzen
- AC-LVDS-, AC-CML-, AC-LVPECL-, HCSL- und 1,8V-LVCMOS-Ausgangsformate
- EEPROM/ROM für benutzerdefinierte Takte beim Einschalten
- Flexible Konfigurationsoptionen
- 1 Hz (1 PPS) zu 800 MHz auf Eingang und Ausgang
- XO-/TCXO-/OCXO-Eingang: 10 bis 100 MHz
- DCO-Modus: < 0,001 ppb/Schritt für eine präzise Taktlenkung (IEEE 1588 PTP-Slave)
- Erweiterte Taktüberwachung und Status
- I2C- oder SPI-Schnittstelle
- PSNR: -83 dBc (50 mVpp Rauschen auf 3,3-V-Versorgung)
- 3,3 V Versorgungsspannung mit Ausgängen von 1,8 V, 2,5 V oder 3,3 V
- Industrie-Temperaturbereich: -40 °C bis +85 °C
Applikationen
- SyncE (G.8262), SONET/SDH (Stratum 3/3E, G.813, GR-1244, GR-253), IEEE 1588 PTP-Slave-Takt oder Optisches Transport-Netzwerk (G.709)
- 400 G Line-Karten, Fabric-Karten für Ethernet-Schalter und Router
- Drahtlose Basisstation (BTS), drahtloses Backhaul
- Prüf- und Messgeräte, medizinische Bildverarbeitung
- Jitter-Reinigung, Wander-Dämpfung und Referenztakt-Erzeugung für 56 G/112 G PAM-4 PHYs, ASICs, FPGAs, SoCs und Prozessoren
Funktionales Blockdiagramm
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