Altera CPLD - komplexe programmierbare Logikbausteine

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Menge RoHS ECAD Model Serie
Montageart
Verpackung/Gehäuse
Betriebsversorgungsspannung
Anzahl der Makrozellen
Anzahl der I/Os
Minimale Betriebstemperatur
Maximale Betriebstemperatur
Maximale Betriebsfrequenz
Verzögerungszeit - Max.
Qualifikation
Verpackung
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
360erwartet ab 21.01.2027
Min.: 1
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MAX V 5M570Z SMD/SMT TQFP-100 1.8 V 440 Macrocell 74 I/O - 40 C + 125 C 152 MHz 9 ns AEC-Q100 Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
379erwartet ab 21.08.2026
Min.: 1
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MAX V 5M570Z SMD/SMT TQFP-144 1.8 V 440 Macrocell 114 I/O 0 C + 70 C 152 MHz 9 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
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356erwartet ab 21.12.2026
Min.: 1
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MAX V 5M570Z SMD/SMT TQFP-144 1.8 V 440 Macrocell 114 I/O - 40 C + 85 C 152 MHz 9 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
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500erwartet ab 07.09.2026
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MAX V 5M80Z SMD/SMT QFP-64 1.8 V 64 Macrocell 54 I/O - 40 C + 125 C 152 MHz 7.5 ns AEC-Q100 Tray
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640Auf Bestellung
Min.: 1
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MAX V 5M80Z SMD/SMT BGA-68 1.8 V 64 Macrocell 52 I/O 0 C + 70 C 152 MHz 7.5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
640Auf Bestellung
Min.: 1
Mult.: 1

MAX V 5M80Z SMD/SMT BGA-68 1.8 V 64 Macrocell 52 I/O 0 C + 70 C 152 MHz 7.5 ns Tray
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1 920Auf Bestellung
Min.: 1
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MAX V 5M80Z SMD/SMT MBGA-68 1.8 V 64 Macrocell 79 I/O - 40 C + 100 C 152 MHz 7.5 ns Tray
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90erwartet ab 11.01.2027
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EPM1270 SMD/SMT FBGA-256 2.5 V, 3.3 V 980 Macrocell 212 I/O 0 C + 70 C 304 MHz 6.2 ns Tray
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74erwartet ab 02.09.2026
Min.: 1
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EPM1270 SMD/SMT FBGA-256 2.5 V, 3.3 V 980 Macrocell 212 I/O - 40 C + 85 C 304 MHz 6.2 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
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448Auf Bestellung
Min.: 1
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EPM240 SMD/SMT FBGA-100 2.5 V, 3.3 V 192 Macrocell 80 I/O 0 C + 70 C 304 MHz 4.7 ns Tray
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85erwartet ab 26.08.2026
Min.: 1
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EPM240 SMD/SMT FBGA-100 2.5 V, 3.3 V 192 Macrocell 80 I/O - 40 C + 85 C 304 MHz 4.7 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
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248erwartet ab 29.10.2026
Min.: 1
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EPM240 SMD/SMT TQFP-100 2.5 V, 3.3 V 192 Macrocell 80 I/O 0 C + 70 C 304 MHz 4.7 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
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85erwartet ab 19.05.2027
Min.: 1
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EPM570 SMD/SMT FBGA-256 2.5 V, 3.3 V 440 Macrocell 160 I/O 0 C + 70 C 304 MHz 5.4 ns Tray
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70erwartet ab 01.09.2026
Min.: 1
Mult.: 1

EPM570 SMD/SMT FBGA-256 2.5 V, 3.3 V 440 Macrocell 160 I/O - 40 C + 85 C 304 MHz 5.4 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
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176erwartet ab 01.09.2026
Min.: 1
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EPM570 SMD/SMT FBGA-100 1.8 V 440 Macrocell 76 I/O 0 C + 70 C 304 MHz 5.4 ns Tray
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40erwartet ab 29.10.2026
Min.: 1
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MAX V 5M570Z SMD/SMT FBGA-256 1.8 V 980 Macrocell 211 I/O 0 C + 70 C 304 MHz 6.2 ns Tray
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500erwartet ab 29.12.2026
Min.: 1
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MAX V 5M40Z SMD/SMT QFP-64 1.8 V 32 Macrocell 54 I/O - 40 C + 125 C 152 MHz 7.5 ns AEC-Q100 Tray
Altera CPLD - komplexe programmierbare Logikbausteine
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1 000erwartet ab 01.12.2026
Min.: 1
Mult.: 1

MAX V 5M40Z SMD/SMT QFP-64 1.8 V 32 Macrocell 54 I/O 0 C + 70 C 152 MHz 7.5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
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250erwartet ab 25.09.2026
Min.: 1
Mult.: 1

MAX V 5M80Z SMD/SMT QFP-64 1.8 V 64 Macrocell 54 I/O 0 C + 70 C 152 MHz 7.5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
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110erwartet ab 29.10.2026
Min.: 1
Mult.: 1

MAX V 5M80Z SMD/SMT TQFP-100 1.8 V 64 Macrocell 79 I/O - 40 C + 125 C 152 MHz 7.5 ns AEC-Q100 Tray
Altera CPLD - komplexe programmierbare Logikbausteine
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Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 1
Mult.: 1

MAX V 5M160Z SMD/SMT BGA-100 1.8 V 128 Macrocell 79 I/O 0 C + 70 C 152 MHz 7.5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
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Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 1
Mult.: 1

MAX V 5M160Z SMD/SMT BGA-100 1.8 V 128 Macrocell 79 I/O - 40 C + 85 C 152 MHz 7.5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
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Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 640
Mult.: 640

MAX V 5M160Z SMD/SMT BGA-68 1.8 V 128 Macrocell 52 I/O 0 C + 70 C 152 MHz 7.5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
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Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 252
Mult.: 84

MAX V 5M2210Z SMD/SMT FBGA-324 Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 429
Mult.: 429

MAX V 5M240Z SMD/SMT BGA-100 1.8 V 192 Macrocell 79 I/O 0 C + 70 C 152 MHz 7.5 ns Tray