programmer CPLD - komplexe programmierbare Logikbausteine

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Menge RoHS ECAD Model Serie
Montageart
Verpackung/Gehäuse
Betriebsversorgungsspannung
Anzahl der Makrozellen
Anzahl der I/Os
Minimale Betriebstemperatur
Maximale Betriebstemperatur
Maximale Betriebsfrequenz
Verzögerungszeit - Max.
Qualifikation
Verpackung
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht auf Lager
Min.: 490
Mult.: 490

MAX V 5M80Z SMD/SMT BGA-64 1.8 V 64 Macrocell 30 I/O 0 C + 70 C 152 MHz 7.5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht auf Lager
Min.: 176
Mult.: 176

EPM1270 SMD/SMT BGA-256 1.8 V 980 Macrocell 212 I/O 0 C + 70 C 304 MHz 6.2 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht auf Lager
Min.: 1
Mult.: 1

EPM570Z SMD/SMT BGA-100 1.8 V 440 Macrocell 76 I/O 0 C + 70 C 152 MHz 9 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
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Min.: 84
Mult.: 84

EPM2210 SMD/SMT FBGA-324 2.5 V, 3.3 V 1700 Macrocell 272 I/O 0 C + 70 C 304 MHz 7 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
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Min.: 1
Mult.: 1

EPM570 SMD/SMT FBGA-100 1.8 V 440 Macrocell 76 I/O - 40 C + 85 C 304 MHz 5.4 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht auf Lager
Min.: 176
Mult.: 176

EPM570 SMD/SMT BGA-256 2.5 V, 3.3 V 440 Macrocell 160 I/O 0 C + 70 C 304 MHz 5.4 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine Auto Grade (AEC-Q100 ) ispMACH4128V
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 450
Mult.: 90

LA4128V-75TN SMD/SMT TQFP-128 3.3 V 128 Macrocell 92 I/O - 40 C + 125 C 168 MHz 7.5 ns AEC-Q100 Tray
Lattice CPLD - komplexe programmierbare Logikbausteine Auto Grade (AEC-Q100 ) ispMACH4128V
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 300
Mult.: 60

LA4128V-75TN SMD/SMT TQFP-144 3.3 V 128 Macrocell 96 I/O - 40 C + 125 C 168 MHz 7.5 ns AEC-Q100 Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht auf Lager
Min.: 1
Mult.: 1

MAX V 5M160Z SMD/SMT BGA-100 1.8 V 128 Macrocell 79 I/O - 40 C + 85 C 152 MHz 7.5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht auf Lager
Min.: 429
Mult.: 429

MAX V 5M240Z SMD/SMT BGA-100 1.8 V 192 Macrocell 79 I/O 0 C + 70 C 152 MHz 7.5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht auf Lager
Min.: 640
Mult.: 640

MAX V 5M240Z SMD/SMT BGA-68 1.8 V 192 Macrocell 52 I/O 0 C + 70 C 152 MHz 7.5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
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Min.: 528
Mult.: 528

EPM570 SMD/SMT BGA-256 1.8 V 440 Macrocell 160 I/O 0 C + 70 C 304 MHz 5.4 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht auf Lager
Min.: 429
Mult.: 429

EPM240Z SMD/SMT BGA-100 1.8 V 192 Macrocell 80 I/O 0 C + 70 C 152 MHz 7.5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht auf Lager
Min.: 176
Mult.: 176

EPM570 SMD/SMT BGA-256 2.5 V, 3.3 V 440 Macrocell 160 I/O - 40 C + 85 C 304 MHz 5.4 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht auf Lager
Min.: 1
Mult.: 1

MAX V 5M80Z SMD/SMT MBGA-64 1.8 V 64 Macrocell 79 I/O 0 C + 85 C 152 MHz 7.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 200
Mult.: 40

LC4384V SMD/SMT TQFP-176 3.3 V 384 Macrocell 128 I/O - 40 C + 105 C 322 MHz 5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 200
Mult.: 40

LC4384V SMD/SMT TQFP-176 3.3 V 384 Macrocell 128 I/O 0 C + 90 C 322 MHz 5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 1 800
Mult.: 360

LC4256ZC SMD/SMT CSBGA-132 1.8 V 256 Macrocell 96 I/O 0 C + 90 C 200 MHz 7.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 300
Mult.: 60

LC4256V SMD/SMT TQFP-144 3.3 V 256 Macrocell 96 I/O - 40 C + 130 C 322 MHz 7.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine 128MC 96 I/O Low Pwr 1.8V 7.5NS
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 1 800
Mult.: 360

ispMACH 4128 SMD/SMT CSBGA-144 1.8 V 128 Macrocell 96 I/O 0 C + 90 C 200 MHz 7.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine 64MC 48 I/O Low Pwr 1.8V 4.7NS
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 2 450
Mult.: 490

ispMACH 4064 SMD/SMT CSBGA-64 1.8 V 64 Macrocell 48 I/O 0 C + 90 C 241 MHz 4.7 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine 128MC 96I/O 1.8V 5.8ns Ultra-Lo Power
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 300
Mult.: 60

ispMACH 4128 SMD/SMT TQFP-144 1.8 V 128 Macrocell 96 I/O 0 C + 90 C 200 MHz 5.8 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine ispJTAG 3.3V 5ns 256MC 128 I/O IND
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 450
Mult.: 90

LC4256V SMD/SMT FTBGA-256 3.3 V 256 Macrocell 160 I/O - 40 C + 105 C 322 MHz 5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine ispJTAG 3.3V 10ns 256MC 128 I/O IND
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 450
Mult.: 90

LC4256V SMD/SMT FTBGA-256 3.3 V 256 Macrocell 160 I/O - 40 C + 105 C 322 MHz 10 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine 256MC 108 I/O Lw Pwr 1.8V 7.5ns
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 1 800
Mult.: 360

ispMACH 4256 SMD/SMT CSBGA-144 1.8 V 256 Macrocell 108 I/O - 40 C + 105 C 200 MHz 7.5 ns Tray