Lattice CPLD - komplexe programmierbare Logikbausteine

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Menge RoHS ECAD Model Serie
Montageart
Verpackung/Gehäuse
Betriebsversorgungsspannung
Anzahl der Makrozellen
Anzahl der I/Os
Minimale Betriebstemperatur
Maximale Betriebsfrequenz
Maximale Betriebstemperatur
Verzögerungszeit - Max.
Qualifikation
Verpackung
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 1 800
Mult.: 360

LC4032ZC SMD/SMT CSBGA-56 1.8 V 32 Macrocell 32 I/O 0 C 267 MHz + 90 C 3.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 1 250
Mult.: 250

LC4032ZC SMD/SMT TQFP-48 1.8 V 32 Macrocell 32 I/O 0 C 267 MHz + 90 C 3.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 1 800
Mult.: 360

LC4064ZC SMD/SMT CSBGA-132 1.8 V 64 Macrocell 64 I/O 0 C 250 MHz + 90 C 3.7 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 1 800
Mult.: 360

LC4064ZC SMD/SMT CSBGA-56 1.8 V 64 Macrocell 32 I/O 0 C 250 MHz + 90 C 3.7 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 450
Mult.: 90

LC4064ZC SMD/SMT TQFP-100 1.8 V 64 Macrocell 64 I/O 0 C 250 MHz + 90 C 3.7 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 1 250
Mult.: 1 250

LC4064ZC SMD/SMT TQFP-48 1.8 V 64 Macrocell 32 I/O 0 C 250 MHz + 90 C 3.7 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 1 800
Mult.: 360

LC4064ZC SMD/SMT CSBGA-132 1.8 V 64 Macrocell 64 I/O 0 C 250 MHz + 90 C 5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 1 800
Mult.: 360

LC4064ZC SMD/SMT CSBGA-132 1.8 V 64 Macrocell 64 I/O - 40 C 250 MHz + 105 C 5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 450
Mult.: 450

LC4064ZC SMD/SMT TQFP-100 1.8 V 64 Macrocell 64 I/O 0 C 250 MHz + 90 C 5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 450
Mult.: 90

LC4064ZC SMD/SMT TQFP-100 1.8 V 64 Macrocell 64 I/O - 40 C 250 MHz + 105 C 5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 1 800
Mult.: 360

LC4064ZC SMD/SMT CSBGA-132 1.8 V 64 Macrocell 64 I/O 0 C 250 MHz + 90 C 7.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 1 800
Mult.: 360

LC4064ZC SMD/SMT CSBGA-132 1.8 V 64 Macrocell 64 I/O - 40 C 250 MHz + 105 C 7.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 1 800
Mult.: 1 800

LC4064ZC SMD/SMT CSBGA-56 1.8 V 64 Macrocell 32 I/O 0 C 250 MHz + 90 C 7.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 1 800
Mult.: 360

LC4064ZC SMD/SMT CSBGA-56 1.8 V 64 Macrocell 32 I/O - 40 C 250 MHz + 105 C 7.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 450
Mult.: 90

LC4064ZC SMD/SMT TQFP-100 1.8 V 64 Macrocell 64 I/O - 40 C 250 MHz + 130 C 7.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 1 250
Mult.: 250

LC4064ZC SMD/SMT TQFP-48 1.8 V 64 Macrocell 32 I/O - 40 C 250 MHz + 130 C 7.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 450
Mult.: 90

LC4128V SMD/SMT TQFP-128 3.3 V 128 Macrocell 92 I/O - 40 C 333 MHz + 105 C 10 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 300
Mult.: 60

LC4128V SMD/SMT TQFP-144 3.3 V 128 Macrocell 96 I/O 0 C 333 MHz + 90 C 2.7 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 450
Mult.: 90

LC4128V SMD/SMT TQFP-128 3.3 V 128 Macrocell 92 I/O - 40 C 333 MHz + 105 C 7.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 300
Mult.: 60

LC4128V SMD/SMT TQFP-144 3.3 V 128 Macrocell 96 I/O - 40 C 333 MHz + 130 C 7.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 1 800
Mult.: 360

LC4128ZC SMD/SMT CSBGA-132 1.8 V 128 Macrocell 96 I/O 0 C 220 MHz + 90 C 4.2 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 450
Mult.: 90

LC4128ZC SMD/SMT TQFP-100 1.8 V 128 Macrocell 64 I/O 0 C 220 MHz + 90 C 4.2 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 1 800
Mult.: 360

LC4128ZC SMD/SMT CSBGA-132 1.8 V 128 Macrocell 96 I/O 0 C 220 MHz + 90 C 7.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 1 800
Mult.: 360

LC4128ZC SMD/SMT CSBGA-132 1.8 V 128 Macrocell 96 I/O - 40 C 220 MHz + 105 C 7.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine 400MHZ 256 Macrocell 3.3 V 7.5 tPD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 19 Wochen
Min.: 1
Mult.: 1

LC4256V SMD/SMT TQFP-144 3.3 V 256 Macrocell 96 I/O 0 C 322 MHz + 90 C 7.5 ns Tray