CDCU877RHAT

Texas Instruments
595-CDCU877RHAT
CDCU877RHAT

Herst.:

Beschreibung:
Takttreiber u. -verteiler 1.8v PLL Clock Drive r A 595-CDCU877RHAR A 595-CDCU877RHAR

ECAD Model:
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Gehäuse:
Ganzes Reel (Sie bestellen ein Vielfaches von 250)

Preis (EUR)

Menge Stückpreis
Erw. Preis
Gurtabschnitt / MouseReel™
€ 10,11 € 10,11
€ 7,93 € 79,30
€ 7,39 € 184,75
€ 6,79 € 679,00
Ganzes Reel (Sie bestellen ein Vielfaches von 250)
€ 6,50 € 1 625,00
€ 6,24 € 3 120,00
€ 6,15 € 6 150,00
5 000 Kostenvoranschlag
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Texas Instruments
Produktkategorie: Takttreiber u. -verteiler
RoHS:  
SSTL-18
400 MHz
SSTL-18
VQFN-40
1.7 V
1.9 V
CDCU877
- 40 C
+ 85 C
Reel
Cut Tape
MouseReel
Marke: Texas Instruments
Feuchtigkeitsempfindlich: Yes
Montageart: SMD/SMT
Betriebsversorgungsstrom: 135 mA
Produkt: Clock Drivers
Produkt-Typ: Clock Drivers & Distribution
Verpackung ab Werk: 250
Unterkategorie: Clock & Timer ICs
Typ: Phase-Locked-Loops (PLLs) and Oscillators
Gewicht pro Stück: 104 mg
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Ausgewählte Attribute: 0

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TARIC:
8542399000
CNHTS:
8542319090
CAHTS:
8542390000
USHTS:
8542390090
JPHTS:
8542390990
MXHTS:
85423999
ECCN:
EAR99

CDCU877 Phasenregelschleifen-Takttreiber

Der Texas Instruments CDCU877 Phasenverriegelungs-Loop-Takttreiber ist ein leistungsstarker Buffer mit geringem Jitter, geringem Versatz und Null-Verzögerung. Das Bauteil verteilt ein Differential-Takteingangspaar (CK, /CK) auf 10 differentielle Paare von Taktausgängen (Yn, /Yn) und ein differentielles Paar von Rückkopplungs-Taktausgängen (FBOUT, /FBOUT). Die Taktausgänge werden durch die Eingangstaktgeber (CK, /CK), die Rückkopplungstaktgeber (FBIN, /FBIN), die LVCMOS-Steuerpins (OE, OS) und den analogen Stromeingang (AVDD) gesteuert. Wenn OE niedrig ist, sind die Taktausgänge, außer FBOUT, /FBOUT deaktiviert, während die interne PLL seine verriegelte Frequenz aufrechterhält. OS (Output Select) ist ein Programmpin, der an GND oder VDD angeschlossen werden muss. Wenn OS hoch ist, funktioniert OE wie zuvor beschrieben. Wenn OS und OE beide niedrig sind, wirkt sich OE nicht auf Y7, /Y7 aus, da diese freilaufend sind. Wenn AVDD geerdet ist, ist die PLL ausgeschaltet und wird zu Testzwecken überbrückt.